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题名/责任者:

Verilog HDL入门/(美) J. Bhasker著 夏宇闻, 甘伟译

出版发行项:

北京:北京航空航天大学出版社,2008

ISBN及定价:

978-7-81124-248-5/CNY39.00

载体形态项:

327页:图;23cm

统一题名:

Verilog HDL primer

丛编项:

国外数字系统设计经典教材系列

个人责任者:

贝斯克 (Bhasker, Jayaram) 著

个人次要责任者:

夏宇闻 译

个人次要责任者:

甘伟 译

学科主题:

硬件描述语言-程序设计

中图法分类号:

TP312

版本附注:

据原书第3版译出

责任者附注:

责任者汉译姓通译: 贝斯克

书目附注:

有书目 (第315页) 和索引

提要文摘附注:

本书简要介绍了Verilog硬件描述语言的基础知识，包括语言的基本内容和基本结构，以及利用该语言在各种层次上对数字系统的建模方法。书中列举了大量实例，帮助读者掌握语言本身和建模方法，对实际数字系统设计也很有帮助。

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