机读格式显示(MARC)
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- 200 1_ |a Verilog HDL与数字电路设计 |A Verilog HDL yu shu zi dian lu she ji |f 王冠, 黄熙, 王鹰编著
- 210 __ |a 北京 |c 机械工业出版社 |d 2006
- 215 __ |a 329页 |c 图 |d 26cm
- 225 2_ |a 硬件电路工程师从入门到提高丛书 |A ying jian dian lu gong cheng shi cong ru men dao ti gao cong shu |f 主编姜雪松
- 410 _0 |1 2001 |a 硬件电路工程师从入门到提高丛书
- 606 0_ |a 数字电路 |A shu zi dian lu |x 电路设计
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- 701 _0 |a 王冠 |A wang guan |4 编著
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